istruzione divwu (Divide Word Unsigned)

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Finalità

Divide il contenuto di un registro generale per il contenuto di un altro registro generale e memorizza il risultato in un terzo registro generale.

Nota: l'istruzione divwu è supportata solo nell'architettura PowerPC® .

Sintassi

bit Valore
0-5 31
6-10 RT
11-15 RA
16-20 RB
21 OE
22-30 459
31 rc
PowerPC® 
div RT, RA, RB
divwu. RT, RA, RB
divwuo RT, RA, RB
divwuo. RT, RA, RB

Descrizione

L'istruzione divwu divide il contenuto del registro di uso generale (GPR) RA per il contenuto del GPR RBe memorizza il risultato nel GPR di destinazione RT. Il dividendo, il divisore e il quoziente vengono interpretati come interi senza segno.

Nel caso di divisione per 0, il contenuto di RT GPR non è definito.

Nota: sebbene l'operazione consideri il risultato come un numero intero senza segno, se Rc è 1, i bit Minore di (LT) zero, Maggiore di (GT) zero e Uguale a (EQ) zero del campo 0 del registro condizioni sono impostati come se il risultato fosse interpretato come un numero intero con segno.

L'istruzione divwu ha quattro formati di sintassi. Ogni modulo di sintassi ha un effetto diverso sul campo 0 del registro delle condizioni e sul registro delle eccezioni a punti fissi.

Elemento Descrizione
Modulo sintassi Overflow Eccezione (OE) Punto fisso Registrazione eccezione Record bit (Rc) Condizione Registra campo 0
div 0 Nessuno 0 Nessuno
divwu. 0 Nessuno 1 LT,GT, EQ, SO
divwuo 1 SO, OV, 0 Nessuno
divwuo. 1 SO, OV 1 LT,GT, EQ, SO

Le quattro forme di sintassi dell'istruzione divwu non influenzano mai il Carry bit (CA) nel Fixed - Point Exception Register. Se il modulo della sintassi imposta il bit OE (Overflow Exception) su 1, l'istruzione influisce sui bit SO (Summary Overflow) e OV (Overflow) nel registro delle eccezioni a punto fisso. Se il modulo della sintassi imposta il bit Record (Rc) su 1, l'istruzione influisce sui bit Minore di (LT) zero, Maggiore di (GT) zero, Uguale a (EQ) zero e Overflow di riepilogo (SO) nel campo del registro condizioni 0.

Parametri

Elemento Descrizione
RT Specifica il registro di destinazione generico in cui è memorizzato il risultato dell'operazione.
RA Specifica il registro di origine generico per il calcolo EA.
RB Specifica il registro di origine generico per il calcolo EA.

Esempi:

  1. Il seguente codice divide il contenuto del GPR 4 per il contenuto del GPR 6 e memorizza il risultato nel GPR 4:
    
# Assume GPR 4 contains 0x0000 0000.
# Assume GPR 6 contains 0x0000 0002.
divwu 4,4,6
# GPR 4 now contains 0x0000 0000.
  2. Il seguente codice divide il contenuto del GPR 4 per il contenuto del GPR 6, memorizza il risultato nel GPR 4 e imposta il campo Registro condizioni 0 per riflettere il risultato dell'operazione:
    
# Assume GPR 4 contains 0x0000 0002.
# Assume GPR 6 contains 0x0000 0002.
divwu. 4,4,6
# GPR 4 now contains 0x0000 0001.
  3. Il seguente codice divide il contenuto di GPR 4 per il contenuto di GPR 6, inserisce il risultato in GPR 4 e imposta i bit Overflow di riepilogo e Overflow nel registro delle eccezioni a punti fissi per riflettere il risultato dell'operazione:
    
# Assume GPR 4 contains 0x0000 0001.
# Assume GPR 6 contains 0x0000 0000.
divwuo 4,4,6
# GPR 4 now contains an undefined quantity.
  4. Il seguente codice divide il contenuto del GPR 4 per il contenuto del GPR 6, inserisce il risultato nel GPR 4 e imposta i bit Overflow di riepilogo e Overflow nel campo 0 del registro delle eccezioni a punto fisso e del registro delle condizioni per riflettere il risultato dell'operazione:
    
# Assume GPR 4 contains 0x8000 0000.
# Assume GPR 6 contains 0x0000 0002.
divwuo. 4,4,6
# GPR 4 now contains 0x4000 0000.